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bini大哥请进,请教关于LPC与FWH

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发表于 2008-8-20 14:35:51 | 显示全部楼层 |阅读模式
请问FWH到底是什么东东?是控制芯片吗?他跟存放bios的Flash ROM芯片有什么关系?他跟LPC总线又有什么关系??
1 n5 T$ x# ^7 f) s
; y. O! i( P3 W; [4 ~Flash ROM芯片是直接连在LPC上的吗?许多Flash ROM芯片资料中说支持FWH模式和LPC模式,是不是说有LPC就不能有FWH了?5 X. @4 W: g+ }6 |6 l8 b( Y

9 O" G0 \# X1 B$ o9 [6 j% `这些问题搞得我云里雾里啊,南狼大哥帮帮忙吧。
发表于 2008-8-21 14:36:05 | 显示全部楼层
Intel® 82802AB/82802AC Firmware Hub (FWH)的data sheet里面,有下面一段话:+ d- p& X$ A4 M3 K3 H* }
The firmware hub relies on the Intel Firmware Hub interface to communicate with the outside world.
2 @0 y3 \0 M4 T/ \* p/ ]* @5 bThis interface consists of four bi-directional signals and one control input. The timing and electrical
) e, s3 Z- T' c& w6 Uparameters of the FWH interface are similar to those of the LPC interface, to provide compatibility* A8 U8 ~3 A/ L' t7 T5 U
between the interfaces, but differ in cases mentioned earlier in this section (clock pin capacitance), as* V- v9 {9 J2 g4 M4 J0 t
well as in certain timing parameters. The Intel ICH has been engineered to accommodate both interfaces,9 g, T1 _! s' O' d6 E6 G+ _$ t" O
which allows the Intel FWH interface signals to be communicated over the same set of pins as LPC. The
2 ?/ Y% B5 Z' Y; o4 I9 f2 r4 n5 hIntel FWH interface is designed to use an LPC-compatible start cycle, with a reserved cycle type code.
; F( P7 v7 A& t. a! E4 fThis ensures that all LPC devices present on the shared interface will ignore cycles destined for the$ G8 b/ f: X0 s2 k( y+ @' M4 M8 ]
FWH, without becoming confused by the different protocol.
, u/ {8 s! `, O& e# tFWH和LPC基本是兼容的,不过FWH比LPC多几组命令- s" G/ V4 O  @- E% W
在ICH9上面LPC和FWH的数据地址控制信号线都是相同pin复用的,所以应该是二选一的吧.# {9 s5 ?+ S  v
另外,可以看看这个:
% M* ~9 F0 U( o4 w3 T& ?0 k! MUS Patent 7249213 - Memory device operable with a plurality of protocols with configuration data stored in non-volatile storage elements
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发表于 2008-9-13 23:54:01 | 显示全部楼层
1、LPC总线简介8 o% q2 }" D& k5 n0 i% W
   LPC(Low Pin Count Interface)全称为“低引脚数接口”,是用于Intel架构主板互连协议,它是主板芯片组与外设之间的连接接口。
: N- B* Y, K* ], F" W   在早期的PC系统中,使用了基于ISA总线标准的8/16位扩展总线,BIOS与ISA子集相连,ISA子集称为X总线。这种体系结构为适配卡与
; s% r9 c# b. f7 B/ X* N   系统设计人员提供了一定的灵活性,但是由于软硬件标准缺乏统一性,所以这种体系结构通信速度较慢,经常在互操作上出现问题。
2 I& W% h6 z) w9 E       1998年初开始,整个业界都在努力从PC系统中取消ISA总线,以降低对系统和操作系统提供商的服务请求成本。几个重要的IT厂商. j/ }% J; O+ _9 L/ y( O% K
   将这一过渡定义为“PC 97设计准则”。随后,在PC 99规范中对过渡提出了更加详尽的计划,并将“即插即用”定为优先选择的扩展机
0 {: \+ a; [6 O& W- i   制。与PCI、USB和1394总线接口标准类似,LPC也提供了对ISA/X总线体系结构下扩展卡的迁移方向。同时,LPC接口规范还定义了可以挂
9 M/ I& f7 I) T, \  ~   接在LPC总线上的功能部件,包括:
+ b; |2 r# f& ]- D) g& Z; q7 i       Super I/O芯片(提供软盘接口、并行接口、串行接口、红外接口及键盘鼠标接口等);, k  y6 o( Z  y" W3 }, v
       音频接口(包括AC 97类似的设计);
8 u' V* L; B0 e  h. V$ t  \       一般应用存储器;) R: Z* [: t/ L2 E9 z. B( g
       BIOS固件存储器。
! ~2 r9 x1 i' L- l& w   ' l* `( L& ]# O% g7 f
   由此,可以总结出LPC总线的设计目的:# \4 h- k4 y, Y
       提供连接外部低速设备的总线接口;
+ @( \. ]! ^; k  K% b. }6 \       与ISA/X总线兼容;
( A$ A- X( @. I3 ~- l       比ISA/X总线使用更少的信号线,提供更好的性能与功能特性。' C+ m: ~7 n3 z1 y" D" I
2、LPC总线的技术特点
/ C. {, Y/ K, k) W' t   LPC总线为多路复用总线,工作在33MHZ下,与PCI总线同步。LPC的“低引脚数”指实际上需要的信号引脚只有7-13个,而ISA总线却
$ ~" m0 L2 u$ w" D( d需要30个以上的信号引脚。LPC总线比ISA总线更适合等待时间短暂的集线器访问,因此可以提高系统的整体性能。LPC总线提供了X总线$ w9 o  {* t( `' R. n: H
所有的循环类型,包括内存、I/O、DMA及总线控制器等。LPC总线接口同步传输,采用PCI时钟协议和信号,从而使传输速率更加容易控制
& |: u; x# s- _* e% q+ G,并防止了系统资源间的冲突。同时由于LPC总线平衡性更强,所以整体性能优于ISA总线系统。
& P2 z/ O& ^9 R* \/ O3 v3 H1 P+ g  Z8 Q9 G5 }
LPC总线接口定义了7个必需的信号和6个可选的信号,这些信号中,很多可以在PCI接口中找到类似的信号。所有LPC主控端与设备端都需要
' y, t& D3 C' l: B' o: U- G实现必须的信号,而可选的信号则可能在主控端或外设端中不需要实现。' D. K) O2 d/ _7 A& L. d( t
   LPC必需的信号
3 e0 ?" {( }* @* W! J& ALAD[3:0] 地址和数据分时复用信号。9 p0 @! y' t/ G% g! A+ Y
LFRAME# 帧周期信号,LFRAME#有效预示总线传输的开始,它由当前主设备驱动。1 c$ {3 D8 r$ C, I5 {9 c# z# ~
LRESET#复位信号。7 B9 I9 {; I- A, P0 D/ E) K
LCLK 33MHZ时钟信号。
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发表于 2008-9-17 18:13:21 | 显示全部楼层
我也有相同的困惑。从FWH spec来看,LPC和FWH是有差别的,这从flash 芯片有LPC模式和FWH模式之分也可以看出来。但从LPC 1.1 spec来看,LPC bus有专门支持FWH的bus cycle: firmware read/ write,从这个角度来说,FWH可以看成是一个LPC bus device。
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发表于 2008-9-18 20:24:11 | 显示全部楼层
看了下FWH spec,LPC 1.1 spec和一些flash chip的文档,大概明白了。) ~% c) e1 Y% [/ D" o

# w. S$ m! R8 n7 n9 l) P& m; V* oHost通过LPC memory cycles来读写LPC接口的flash芯片上的数据。但是LPC memory cycles一次只能访问一个字节,性能较差。为了加快flash芯片的访问速度,Intel引入了FWH接口对LPC 1.0接口加以扩展。FWH接口和LPC接口兼容,复用了LPC接口中的5根信号线,并使用LPC接口中保留的两个cycle来支持多字节的传输。这两个cycle随后补加入了LPC 1.1 spec,即firmware read/write cycles。因为FWH接口是需要Intel授权才能使用的,所以一般非Intel的芯片组上是没有FWH接口的。
3 B* v3 M' w) t5 O9 b. g1 Z  w+ F0 P  c% e' ~$ q
市面上许多的flash芯片支持FWH/LPC双接口模式,目的是为了同时支持Intel和非Intel的芯片组。当工作在FWH接口模式下时,flash芯片支持firmware read/write cycles,如果是在LPC接口模式下时,则支持普通的LPC memory cycles。
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发表于 2008-9-19 10:11:22 | 显示全部楼层
学习了, ' a& ^% s% F% v0 ]
谢谢!
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发表于 2009-2-16 21:10:41 | 显示全部楼层
還有一點因素是當初南橋陣營不同的問題
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发表于 2009-2-19 10:28:31 | 显示全部楼层
我之前也搞不懂,终于明白了。还是这里高手多!
7 ^2 n) ]* c) D2 Z* k* Q9 c2 h0 g5 L2 L! M. J
另外,我看ICH8的datasheet,有两个SPI接口可以接FLASH。那如果是用SPI FLASH的话,mem map中原来target为FWH的部分是不是就自动target到SPI了?还是有寄存器配置选择?
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发表于 2009-3-11 08:35:07 | 显示全部楼层
选择SPI还是LPC启动是由硬件决定的,好像是由南桥SPI_CSI#和GNT0#的电平决定。
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发表于 2009-5-21 23:01:40 | 显示全部楼层

顶一下

好东西!真的是在这里学到不少东西啊
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发表于 2010-11-18 11:13:45 | 显示全部楼层
大概知道FWH是做什么的了
  ~# P# x) F* W) L8 _不过我认为fwh好像是用来控制shadow ram的吧 将内存映射和分配1 W% T* j* _, L; e$ |, d  }! ~
个人愚见
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发表于 2012-4-9 10:39:58 | 显示全部楼层
楼上严重错误!请多看SPEC
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