bini大哥请进，请教关于LPC与FWH

coodkey

请问FWH到底是什么东东？是控制芯片吗？他跟存放bios的Flash ROM芯片有什么关系？他跟LPC总线又有什么关系？？
) H1 C2 L) Q3 Q- }
$ |+ D$ D0 _6 j, VFlash ROM芯片是直接连在LPC上的吗？许多Flash ROM芯片资料中说支持FWH模式和LPC模式，是不是说有LPC就不能有FWH了？
0 s" {+ T- L2 [
+ o" R! E( W; Z; ?5 e7 f8 X' m" y1 ^这些问题搞得我云里雾里啊，南狼大哥帮帮忙吧。

xtdumpling

在Intel® 82802AB/82802AC Firmware Hub (FWH)的data sheet里面,有下面一段话:
The firmware hub relies on the Intel Firmware Hub interface to communicate with the outside world.
! W( K6 e) A0 {# [This interface consists of four bi-directional signals and one control input. The timing and electrical
parameters of the FWH interface are similar to those of the LPC interface, to provide compatibility
between the interfaces, but differ in cases mentioned earlier in this section (clock pin capacitance), as
well as in certain timing parameters. The Intel ICH has been engineered to accommodate both interfaces,
which allows the Intel FWH interface signals to be communicated over the same set of pins as LPC. The
' |0 f' m+ h# WIntel FWH interface is designed to use an LPC-compatible start cycle, with a reserved cycle type code.
This ensures that all LPC devices present on the shared interface will ignore cycles destined for the
FWH, without becoming confused by the different protocol.
FWH和LPC基本是兼容的,不过FWH比LPC多几组命令
+ E; t6 i# g( n在ICH9上面LPC和FWH的数据地址控制信号线都是相同pin复用的,所以应该是二选一的吧.
另外,可以看看这个:
US Patent 7249213 - Memory device operable with a plurality of protocols with configuration data stored in non-volatile storage elements

sz_lxh

1、LPC总线简介
   LPC(Low Pin Count Interface)全称为“低引脚数接口”，是用于Intel架构主板互连协议，它是主板芯片组与外设之间的连接接口。
   在早期的PC系统中，使用了基于ISA总线标准的8/16位扩展总线，BIOS与ISA子集相连，ISA子集称为X总线。这种体系结构为适配卡与
   系统设计人员提供了一定的灵活性，但是由于软硬件标准缺乏统一性，所以这种体系结构通信速度较慢，经常在互操作上出现问题。
* _  r6 v1 }8 @; ]8 G       1998年初开始，整个业界都在努力从PC系统中取消ISA总线，以降低对系统和操作系统提供商的服务请求成本。几个重要的IT厂商
6 j8 b" J6 B* H' e   将这一过渡定义为“PC 97设计准则”。随后，在PC 99规范中对过渡提出了更加详尽的计划，并将“即插即用”定为优先选择的扩展机
   制。与PCI、USB和1394总线接口标准类似，LPC也提供了对ISA/X总线体系结构下扩展卡的迁移方向。同时，LPC接口规范还定义了可以挂
0 _5 L7 U6 `2 _8 Q+ d7 N1 T   接在LPC总线上的功能部件，包括：
: k% g  O% N( C9 s0 g& d& j       Super I/O芯片（提供软盘接口、并行接口、串行接口、红外接口及键盘鼠标接口等）；
* d$ _; u/ ~& X, d9 t: f       音频接口（包括AC 97类似的设计）；
       一般应用存储器；
& G. _* f; a& L) ]       BIOS固件存储器。
   
   由此，可以总结出LPC总线的设计目的：
2 j- P0 [7 B4 N+ X       提供连接外部低速设备的总线接口；
" p* r3 z0 T( j* A. G0 c1 |       与ISA/X总线兼容；
       比ISA/X总线使用更少的信号线，提供更好的性能与功能特性。
2、LPC总线的技术特点
6 C% S  H4 T8 C6 P7 Z! d  N' u   LPC总线为多路复用总线，工作在33MHZ下，与PCI总线同步。LPC的“低引脚数”指实际上需要的信号引脚只有7-13个，而ISA总线却
需要30个以上的信号引脚。LPC总线比ISA总线更适合等待时间短暂的集线器访问，因此可以提高系统的整体性能。LPC总线提供了X总线
+ u# [7 B  m- X9 G# J* c6 `6 _6 a所有的循环类型，包括内存、I/O、DMA及总线控制器等。LPC总线接口同步传输，采用PCI时钟协议和信号，从而使传输速率更加容易控制
7 Z! n8 ~" `( \1 {，并防止了系统资源间的冲突。同时由于LPC总线平衡性更强，所以整体性能优于ISA总线系统。
5 ^  a; |* b0 D9 f2 b; P4 U: b
  t% x* Q5 t! G* p2 n4 b. |LPC总线接口定义了7个必需的信号和6个可选的信号，这些信号中，很多可以在PCI接口中找到类似的信号。所有LPC主控端与设备端都需要
实现必须的信号，而可选的信号则可能在主控端或外设端中不需要实现。
   LPC必需的信号
" d4 u2 P8 e  w  H: v% }' c6 ELAD[3：0] 地址和数据分时复用信号。
5 S, J5 K! Y. i2 q- bLFRAME# 帧周期信号，LFRAME#有效预示总线传输的开始，它由当前主设备驱动。
LRESET#复位信号。
% {  r) Y) A3 N2 T* M5 S8 hLCLK 33MHZ时钟信号。

srcore

我也有相同的困惑。从FWH spec来看，LPC和FWH是有差别的，这从flash 芯片有LPC模式和FWH模式之分也可以看出来。但从LPC 1.1 spec来看，LPC bus有专门支持FWH的bus cycle: firmware read/ write，从这个角度来说，FWH可以看成是一个LPC bus device。

srcore

看了下FWH spec，LPC 1.1 spec和一些flash chip的文档，大概明白了。

Host通过LPC memory cycles来读写LPC接口的flash芯片上的数据。但是LPC memory cycles一次只能访问一个字节，性能较差。为了加快flash芯片的访问速度，Intel引入了FWH接口对LPC 1.0接口加以扩展。FWH接口和LPC接口兼容，复用了LPC接口中的5根信号线，并使用LPC接口中保留的两个cycle来支持多字节的传输。这两个cycle随后补加入了LPC 1.1 spec，即firmware read/write cycles。因为FWH接口是需要Intel授权才能使用的，所以一般非Intel的芯片组上是没有FWH接口的。
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市面上许多的flash芯片支持FWH/LPC双接口模式，目的是为了同时支持Intel和非Intel的芯片组。当工作在FWH接口模式下时，flash芯片支持firmware read/write cycles，如果是在LPC接口模式下时，则支持普通的LPC memory cycles。

xtdumpling

学习了,
谢谢!

eject

還有一點因素是當初南橋陣營不同的問題

ak756

我之前也搞不懂，终于明白了。还是这里高手多！

" W* }7 G5 k. i' Z另外，我看ICH8的datasheet，有两个SPI接口可以接FLASH。那如果是用SPI FLASH的话，mem map中原来target为FWH的部分是不是就自动target到SPI了？还是有寄存器配置选择？

knight956

选择SPI还是LPC启动是由硬件决定的，好像是由南桥SPI_CSI#和GNT0#的电平决定。

zhanghmjm

好东西！真的是在这里学到不少东西啊

shaopy

大概知道FWH是做什么的了
不过我认为fwh好像是用来控制shadow ram的吧 将内存映射和分配
个人愚见

凉风有讯

楼上严重错误！请多看SPEC